5 chipset chipset chipset chipset chipset, Advanced chipset settings – Asus P5LD2 Manuel d'utilisation

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A S U S P 5 L D 2

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4 - 2 7

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Advanced Chipset Settings

Advanced Chipset Settings

Advanced Chipset Settings

Advanced Chipset Settings

Advanced Chipset Settings

Configure DRAM Timing by SPD [Enabled]

Configure DRAM Timing by SPD [Enabled]

Configure DRAM Timing by SPD [Enabled]

Configure DRAM Timing by SPD [Enabled]

Configure DRAM Timing by SPD [Enabled]

Lorsque cet élément est activé, les paramètres de timing de DRAM sont
réglés en fonction du SPD de la DRAM (Serial Presence Detect). Désactivé,
vous pouvez régler les paramètres de timings DRAM à la main via les sous-
élements. Les sous-éléments suivants apparaissent lorsque cet élément est
passé sur Disabled. Options de configuration: [Disabled] [Enabled]

DRAM CAS# Latency [5 Clocks]
Contrôle la latence entre la commande de lecture SDRAM et le temps
auquel la donnée devient effectivement disponible.
Options de configuration: [6 Clocks] [5 Clocks] [4 Clocks] [3 Clocks]

DRAM RAS# Precharge [4 Clocks]
Contrôle les périodes d’inactivité après avoir envoyé une commande
precharge à la DDR SDRAM. Options de configuration: [2 Clocks] [3
Clocks] [4 Clocks] [5 Clocks] [6 Clocks]

DRAM RAS# to CAS# Delay [4 Clocks]
Contrôle la latence entre la commande active de la DDR SDRAM et la
commande lecture/écriture. Options de configuration:[2 Clocks] [3
Clocks] [4 Clocks] [5 Clocks] [6 Clocks]

DRAM RAS# Activate to Precharge [15 Clocks]
Règle le timing RAS Activate sur Precharge timing.
Options de configuration: [4 Clocks] [5 Clocks] ~ [18 Clocks]

DRAM Write Recovery Time [4 Clocks]
Règle le paramètre DRAM Write Recover Time. Options de
configuration: [2 Clocks] [3 Clocks] [4 Clocks] [5 Clocks] [6 Clocks]

4.4.5

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Chipset

Chipset

Chipset

Chipset

Chipset

Le menu chipset vous permet de modifier les paramètres avancés du chipset.
Choisissez un élément et pressez <Entrée> pour afficher le sous-menu.

Select Screen
Select Item
+- Change Option
F1 General Help
F10 Save and Exit
ESC Exit

Advanced Chipset Settings

Configure DRAM Timing by SPD [Enabled]

Hyper Path 3

[Auto]

Booting Graphic Adapter Priori

[PCI Express/PCI]

PEG Buffer Length

[Auto]

Link Latency

[Auto]

PEG Root Control

[Auto]

PEG Link Mode

[Auto]

Slot Power

[Auto]

High Priority Port Select

[Disabled]

Enable or disable
DRAM timing.

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